Diseño e implementación de un ambiente de verificación funcional con estándar UVM para segunda versión de microcontrolador Siwa
Wedi'i Gadw mewn:
| Awdur: | |
|---|---|
| Fformat: | proyecto fin de carrera |
| Dyddiad Cyhoeddi: | 2022 |
| Disgrifiad: | Proyecto de Graduación (Licenciatura en Ingeniería Electrónica) Instituto Tecnológico de Costa Rica, Escuela de Ingeniería Electrónica, 2022 |
| Gwlad: | RepositorioTEC |
| Sefydliad: | Instituto Tecnológico de Costa Rica |
| Repositorio: | RepositorioTEC |
| Iaith: | Español |
| OAI Identifier: | oai:repositoriotec.tec.ac.cr:2238/15259 |
| Mynediad Ar-lein: | https://hdl.handle.net/2238/15259 |
| Allweddair: | Diseño -- Ambiente de verificación funcional Metodología de Verificación Universal (UVM) Microcontroladores Siwa Circuitos integrados digitales Usos -- Interfaces Dispositivos periféricos Plataforma -- Pruebas Device Under Test (DUT) Design -- Functional verification environment Universal Verification Methodology (UVM) Siwa microcontrollers Digital integrated circuits Uses – Interfaces Peripheral devices Platform -- Testing Research Subject Categories::TECHNOLOGY::Electrical engineering, electronics and photonics |