Implementación de un ambiente de verificación UART mediante método UVM
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| Autor: | |
|---|---|
| Formato: | proyecto fin de carrera |
| Data de Publicação: | 2018 |
| Descrição: | Proyecto de Graduación (Licenciatura en Ingeniería Electrónica) Instituto Tecnológico de Costa Rica, Escuela de Ingeniería Electrónica, 2018. |
| País: | RepositorioTEC |
| Recursos: | Instituto Tecnológico de Costa Rica |
| Repositorio: | RepositorioTEC |
| Idioma: | Español |
| OAI Identifier: | oai:repositoriotec.tec.ac.cr:2238/10412 |
| Acesso em linha: | https://hdl.handle.net/2238/10412 |
| Palavra-chave: | Circuitos Dispositivos UART (Transmisor–Receptor Asíncrono Universal) UVM (Metodología de Verificación Universal) Research Subject Categories::TECHNOLOGY::Electrical engineering, electronics and photonics::Electronics |