Diseño e implementación de hardware para optimizar la Unidad Aritmética de Coma Flotante de un procesador de aplicación específíca
Wedi'i Gadw mewn:
| Awdur: | |
|---|---|
| Fformat: | proyecto fin de carrera |
| Dyddiad Cyhoeddi: | 2016 |
| Disgrifiad: | Proyecto de Graduación (Licenciatura en Ingeniería Electrónica) Instituto Tecnológico de Costa Rica. Escuela de Ingeniería Electrónica, 2016. |
| Gwlad: | RepositorioTEC |
| Sefydliad: | Instituto Tecnológico de Costa Rica |
| Repositorio: | RepositorioTEC |
| Iaith: | Español |
| OAI Identifier: | oai:repositoriotec.tec.ac.cr:2238/7064 |
| Mynediad Ar-lein: | https://hdl.handle.net/2238/7064 |
| Allweddair: | Sistemas lógicos Hardware Punto de equilibrio Arquitectura Aritmética Research Subject Categories::TECHNOLOGY::Electrical engineering, electronics and photonics::Electrical engineering |