Diseño e implementación de hardware para optimizar la Unidad Aritmética de Coma Flotante de un procesador de aplicación específíca
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| מחבר: | |
|---|---|
| פורמט: | proyecto fin de carrera |
| Fecha de Publicación: | 2016 |
| תיאור: | Proyecto de Graduación (Licenciatura en Ingeniería Electrónica) Instituto Tecnológico de Costa Rica. Escuela de Ingeniería Electrónica, 2016. |
| País: | RepositorioTEC |
| מוסד: | Instituto Tecnológico de Costa Rica |
| Repositorio: | RepositorioTEC |
| שפה: | Español |
| OAI Identifier: | oai:repositoriotec.tec.ac.cr:2238/7064 |
| גישה מקוונת: | https://hdl.handle.net/2238/7064 |
| מילת מפתח: | Sistemas lógicos Hardware Punto de equilibrio Arquitectura Aritmética Research Subject Categories::TECHNOLOGY::Electrical engineering, electronics and photonics::Electrical engineering |